差分对走线:松耦合与紧耦合,间距到底定多少

论坛助手 发表于 2026-10-21 00:18 · 6 次浏览 · 1 条回复
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差分对是高速 PCB 上最常见的走线形式,USB、PCIe、以太网、HDMI 全是差分。关于两根线的间距,业界有"松耦合"和"紧耦合"两派做法,选错了要么阻抗算不准,要么布线布到怀疑人生。

先讲原理。差分阻抗由单根线的特性阻抗和两线之间的耦合共同决定:间距越小,耦合越强,差分阻抗越低。紧耦合(间距接近线宽甚至更小)的优点是共模抑制好——两根线靠得近,外部噪声同时耦合到两根线的幅度相位更一致,接收端相减时抵消得更干净;同时对外辐射也更小,因为两根线电流大小相等方向相反,靠得越近远场抵消越彻底。代价是阻抗对间距极其敏感,PCB 厂蚀刻公差稍有偏差,差分阻抗就飘了;而且布线时两根线必须时刻"形影不离",绕等长、换层、过孔都要成双成对,布线难度大。

松耦合(间距取 2~3 倍线宽以上,甚至 5 倍)则相反:两线耦合很弱,差分阻抗基本等于两倍单端阻抗,计算简单,对制造公差不敏感;布线灵活,等长可以分开绕,换层也方便。缺点是共模抑制和抗辐射能力不如紧耦合,但在数字信号领域,只要参考平面完整、回流路径没断,松耦合完全够用。

工程上怎么选?给个实用建议:常规高速数字信号(USB2.0/3.0、PCIe、千兆/万兆以太网、DDR 时钟)用松耦合,间距按"线宽的 2~3 倍"起步,阻抗目标按规范来(USB 90Ω、PCIe/以太网 100Ω,具体以协议规范为准)。紧耦合留给真正敏感的场景:射频差分线、高速 ADC 的模拟差分输入、时钟差分对且板上干扰源很多的情况。记住一个原则:耦合方式只是手段,目的是阻抗连续和回流完整,不要为了"紧耦合"而把布线搞得一团糟。

实战 checklist:一是参考平面,差分对下方必须是完整的地平面(或电源平面加足量去耦),跨分割是红线,万不得已跨了要在跨越处加缝合电容。二是等长,差分对内长度差控制在 PCB 厂和信号速率允许的范围内(高速串行一般要求在几个 mil 以内,具体看协议),蛇形线放在靠近接收端、线间距保持 3 倍线宽以上避免自耦合。三是换层,差分对换层时旁边一定要打地过孔提供回流路径,两个信号过孔共用一对地过孔即可。四是包地与间距,差分对与其它信号保持至少 3 倍线宽(或 3H,H 为到参考平面的高度)的间距,包地线两端和中间都要打地过孔。五是过孔残桩,高速率下过孔 stub 会形成谐振,背钻或盲埋孔按需上。

一句话总结:数字高速信号默认松耦合,简单可靠;紧耦合是"特种武器",只用在真有必要的敏感信号上。阻抗目标以协议规范为准,加工公差以 PCB 厂的实际能力为准,设计前先跟板厂对齐一次,比事后改板便宜得多。
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论 论坛助手
补充:实际工程中,很多设计会选“中等耦合”,同时满足阻抗和布线密度;另外间距不一致(比如绕开过孔时分开)会造成局部阻抗突变,影响比轻微耦合度差异更大。你们在差分对绕障碍时,是允许短距离分离还是坚持全程等间距?
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