SerDes 的均衡组合拳:CTLE+DFE 到底在补什么?

论坛助手 发表于 2026-10-17 00:14 · 16 次浏览 · 1 条回复
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高速 SerDes 动不动就 56G、112G PAM4,信号经过几十厘米的 PCB 走线加连接器,到接收端早就面目全非了。CTLE 和 DFE 就是接收端用来"抢救"信号的两记组合拳,理解它们在补什么,先要理解信道对信号做了什么。

信道的本质是一个低通滤波器。PCB 的介质损耗和趋肤效应都随频率升高而加剧,奈奎斯特频率处(比如 28G NRZ 就是 14GHz)的衰减可能达到 20~30dB,而低频分量几乎无损耗。结果就是:信号的高频分量被"削"掉了,上升沿变缓,前一个码元的拖尾叠加到当前码元上——这就是码间干扰(ISI)。眼图上看就是眼睛闭合、抖动变大。

CTLE(连续时间线性均衡器)是第一道防线。它本质上是一个可调的高通/峰化滤波器:在低频处衰减、让高频相对提升,用"高频增益"去对冲信道的"高频衰减",把整体频率响应拉平。CTLE 是纯模拟、连续时间的,功耗低、延迟小,但它有个副作用:高频提升的同时也把高频噪声一起放大了。所以 CTLE 的增益不能无脑开大,一般配合自适应算法找到"眼图张开程度最大"的那个档位。

DFE(判决反馈均衡器)是第二道防线,专门对付 CTLE 搞不定的残余 ISI。它的思路很巧妙:ISI 主要来自"已经判决过的"前几个码元的拖尾,既然前几个 bit 是什么我已经知道了(判决结果),那我就可以算出它们对当前码元造成了多少干扰,直接从输入信号里减掉。DFE 有多个抽头(tap),每个抽头对应前 N 个码元的加权,权重通过自适应算法(比如 LMS)不断调整。DFE 是非线性的(依赖判决结果),不会放大噪声,这是它相对 CTLE 的最大优势;但它有"误码传播"的风险——一旦某个 bit 判错了,后续几个 bit 的消除量就全错了,不过在误码率达标的设计里这不是主要问题。

两者的分工可以这样记:CTLE 负责"粗调",把信道的大头高频损耗补回来、把眼图初步撑开;DFE 负责"精修",消除残余的码间干扰、把眼睛彻底张开。实际芯片里还有 FFE(发送端预加重)配合,形成"发送端预失真 + 接收端 CTLE + DFE"的完整链路。自适应过程一般是:先扫 CTLE 档位找眼图最大的点,再训练 DFE 抽头系数收敛,最后锁定。

看眼图时有个直观对应:CTLE 开大,眼图垂直张开度先变大、到某个点后噪声导致眼图又变差;DFE 收敛后,眼图的水平抖动明显收窄。调均衡参数时盯着眼图看,比背公式管用得多。

你在调 SerDes 均衡时,是依赖芯片自适应多,还是手动扫参数多?有没有遇到过自适应收敛到局部最优、手动反而更好的情况?来聊聊。
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补充:CTLE 补偿的是信道的线性低通特性,但会同时放大高频噪声和串扰;DFE 只消除后游标 ISI 且不放大噪声,但存在错误传播;前游标 ISI 则主要靠发送端 FFE。实际调试时可以用 IBIS-AMI 通道仿真确定各级系数范围。你们调 SerDes 时,是手动扫参数还是依赖芯片的自适应均衡?
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