论
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定点 DSP 和浮点 DSP 的选择，直接影响开发周期、功耗和 BOM 成本。
一、两者区别
定点 DSP 用整数（常见 16/32 位）表示数据，需要工程师手动管理 Q 格式和溢出，硬件简单、功耗低、成本低，适合算法成熟、批量大的产品，例如语音编解码、电机控制、通信基带。
浮点 DSP 支持 IEEE 754 单/双精度，动态范围大（单精度约 ±3.4×10^38），无需反复做定标，算法从 MATLAB 移植快，适合雷达、仪器、音频后期等需要高精度和快速迭代的场景。TI C674x、C66x 等系列同时支持定点与浮点。
二、选型四要素
1. 算力：先算出算法每秒需要的乘加次数。例如 256 阶 FIR、48kHz 采样，约需 12.3M MAC/s，再按 30%~50% 余量选芯片；
2. 功耗：同级别下定点内核功耗更低，电池设备优先考虑；
3. 工具链：CCS IDE、DSPLIB/MATHLIB 优化库、编译器内联函数是否成熟；
4. 外设：McASP/McBSP、EMIF、SRIO、PCIe、以太网是否满足系统需求。
三、常见坑
1. 定点化不充分：Q15 累加未扩展到 40 位累加器，长滤波器溢出；
2. 浮点代码未开优化，或误用双精度运算导致性能骤降；
3. 只看主频，忽略内存带宽与缓存配置，实际吞吐远低于峰值；
4. 忽视长期供货，老型号停产后迁移成本高。
讨论：
1. 现在新项目你们还选纯 DSP，还是转向带 DSP 指令的 Cortex-M7/A 核或 FPGA？
2. 定点化仿真你们用 MATLAB Fixed-Point 还是自写 C 模型？
一、两者区别
定点 DSP 用整数（常见 16/32 位）表示数据，需要工程师手动管理 Q 格式和溢出，硬件简单、功耗低、成本低，适合算法成熟、批量大的产品，例如语音编解码、电机控制、通信基带。
浮点 DSP 支持 IEEE 754 单/双精度，动态范围大（单精度约 ±3.4×10^38），无需反复做定标，算法从 MATLAB 移植快，适合雷达、仪器、音频后期等需要高精度和快速迭代的场景。TI C674x、C66x 等系列同时支持定点与浮点。
二、选型四要素
1. 算力：先算出算法每秒需要的乘加次数。例如 256 阶 FIR、48kHz 采样，约需 12.3M MAC/s，再按 30%~50% 余量选芯片；
2. 功耗：同级别下定点内核功耗更低，电池设备优先考虑；
3. 工具链：CCS IDE、DSPLIB/MATHLIB 优化库、编译器内联函数是否成熟；
4. 外设：McASP/McBSP、EMIF、SRIO、PCIe、以太网是否满足系统需求。
三、常见坑
1. 定点化不充分：Q15 累加未扩展到 40 位累加器，长滤波器溢出；
2. 浮点代码未开优化，或误用双精度运算导致性能骤降；
3. 只看主频，忽略内存带宽与缓存配置，实际吞吐远低于峰值；
4. 忽视长期供货，老型号停产后迁移成本高。
讨论：
1. 现在新项目你们还选纯 DSP，还是转向带 DSP 指令的 Cortex-M7/A 核或 FPGA？
2. 定点化仿真你们用 MATLAB Fixed-Point 还是自写 C 模型？
